MPC8536DS datasheet(2/126 Pages) FREESCALE

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MPC8536E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 5

Freescale Semiconductor

Table of Contents

Pin Assignments and Reset States . . . . . . . . . . . . . . . . . . . . .3

1.1

Pin Map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .4

Electrical Characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . .21

2.1

Overall DC Electrical Characteristics . . . . . . . . . . . . . .21

2.2

Power Sequencing . . . . . . . . . . . . . . . . . . . . . . . . . . . .25

2.3

Power Characteristics . . . . . . . . . . . . . . . . . . . . . . . . . .26

2.4

Input Clocks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .29

2.5

RESET Initialization . . . . . . . . . . . . . . . . . . . . . . . . . . .31

2.6

DDR2 and DDR3 SDRAM . . . . . . . . . . . . . . . . . . . . . .32

2.7

eSPI . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .38

2.8

DUART . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .40

2.9

Ethernet: Enhanced Three-Speed Ethernet (eTSEC),

MII Management . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .40

2.10 Ethernet Management Interface Electrical Characteristics

2.11 USB. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .63

2.12 enhanced Local Bus Controller (eLBC) . . . . . . . . . . . .66

2.13 Enhanced Secure Digital Host Controller (eSDHC) . . .75

2.14 Programmable Interrupt Controller (PIC) . . . . . . . . . . .77

2.15 JTAG . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .77

2.16 Serial ATA (SATA) . . . . . . . . . . . . . . . . . . . . . . . . . . . . .79

2.17 I2C . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .85

2.18 GPIO . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .88

2.19 PCI . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .89

2.20 High-Speed Serial Interfaces . . . . . . . . . . . . . . . . . . . .91

2.21 PCI Express. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 100

2.23 Clocking. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 106

2.24 Thermal . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110

Hardware Design Considerations . . . . . . . . . . . . . . . . . . . . 114

3.1

System Clocking . . . . . . . . . . . . . . . . . . . . . . . . . . . . 114

3.2

Power Supply Design and Sequencing . . . . . . . . . . . 114

3.3

Pin States in Deep Sleep State . . . . . . . . . . . . . . . . . 115

3.4

Decoupling Recommendations . . . . . . . . . . . . . . . . . 115

3.5

SerDes

Block

Power

Supply

Decoupling

Recommendations. . . . . . . . . . . . . . . . . . . . . . . . . . . 116

3.6

Connection Recommendations . . . . . . . . . . . . . . . . . 116

3.7

Pull-Up and Pull-Down Resistor Requirements . . . . . 116

3.8

Output Buffer DC Impedance . . . . . . . . . . . . . . . . . . 116

3.9

Configuration Pin Muxing . . . . . . . . . . . . . . . . . . . . . 117

3.10 JTAG Configuration Signals . . . . . . . . . . . . . . . . . . . 118

3.11 Guidelines for High-Speed Interface Termination . . . 120

Ordering Information . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 121

4.1

Part Numbers Fully Addressed by this Document. . . 122

4.2

Part Marking . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 122

4.3

Part Numbering . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 123

Package Information . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 123

5.1

Package Parameters for the FC-PBGA . . . . . . . . . . . 123

5.2

Mechanical Dimensions of the FC-PBGA . . . . . . . . . 124

Product Documentation. . . . . . . . . . . . . . . . . . . . . . . . . . . . 125

Document Revision History . . . . . . . . . . . . . . . . . . . . . . . . . 125

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