PSD813F2 datasheet(5/128 Pages) STMICROELECTRONICS

5 / 128 page

PSD8XXFX

Contents

Doc ID 7833 Rev 7

5/128

16.17 OMC Mask register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74

16.18 Input macro (IMC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74

16.19 Enable Out . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 75

16.20 Ports A and B – functionality and structure . . . . . . . . . . . . . . . . . . . . . . . 75

16.21 Port C – functionality and structure . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 76

16.22 Port D – functionality and structure . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 76

16.23 External Chip Select . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77

Power management . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 79

17.1

Automatic Power-down (APD) Unit and Power-down mode . . . . . . . . . . . 80

17.2

For users of the HC11 (or compatible) . . . . . . . . . . . . . . . . . . . . . . . . . . . 81

17.3

Other power saving options . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 81

17.4

PLD power management . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 82

17.5

PSD Chip Select input (CSI, PD2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 84

17.6

Input clock . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 84

17.7

Input control signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 84

Reset timing and device status at reset . . . . . . . . . . . . . . . . . . . . . . . . 85

18.1

Power-up reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 85

18.2

Warm reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 85

18.3

I/O pin, register and PLD status at Reset . . . . . . . . . . . . . . . . . . . . . . . . . 85

18.4

Reset of Flash memory erase and program cycles (on the PSD834Fx) . 85

Programming in-circuit using the JTAG serial interface . . . . . . . . . . . 87

19.1

Standard JTAG signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 87

19.2

JTAG extensions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 88

19.3

Security and Flash memory protection . . . . . . . . . . . . . . . . . . . . . . . . . . . 88

Initial delivery state . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 90

Maximum rating . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 91

AC/DC parameters . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 92

Package mechanical . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 116

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