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TNETX4090GGP 数据表(PDF) 3 Page - Texas Instruments

部件名 TNETX4090GGP
功能描述  ThunderSWITCH IIE 9-PORT 100-/1000-MBIT/S ETHERNETE SWITCH
PDF  78 Pages
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制造商  TI1 [Texas Instruments]
网页  http://www.ti.com
标志 TI1 - Texas Instruments

TNETX4090GGP 数据表(HTML) 3 Page - Texas Instruments

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TNETX4090
ThunderSWITCH II™ 9-PORT 100-/1000-MBIT/S ETHERNET™ SWITCH
SPWS044E – DECEMBER 1997 – REVISED AUGUST 1999
3
POST OFFICE BOX 655303
• DALLAS, TEXAS 75265
PCS Duplex LED
45
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
RDRAM Interface
45
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
JTAG Interface
47
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
HIGHZ Instruction
47
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
RACBIST Instruction
47
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Frame Routing
48
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
VLAN Support
48
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Address Maintenance
49
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Port Trunking/Load Sharing
54
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Port-Trunking Example
55
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Extended Port Awareness
55
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Flow Control
56
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Other Flow-Control Mechanisms
57
. . . . . . . . . . . . . . . . . . . . . . . . .
System Test Capabilities
57
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
RDRAM
57
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Writing RDRAM
57
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Reading RDRAM
58
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Internal Wrap Test
58
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Duplex Wrap Test
59
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Absolute Maximum Ratings
60
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Recommended Operating Conditions
60
. . . . . . . . . . . . . . . . . . . . .
Electrical Characteristics
61
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Timing Requirements
61
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
JTAG Interface
61
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Control Signals
61
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Physical Medium Attachment Interface (Port 8)
62
. . . . . . . . . . . .
Receive
62
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Transmit
63
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
GMII (Port 8)
64
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
MII (Ports 0–8)
66
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
RDRAM Interface
68
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
DIO Interface
69
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
EEPROM Interface
71
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
LED Interface
72
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Parameter Measurement Information
73
. . . . . . . . . . . . . . . . . . . . . .
Mechanical Data
76
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Description
1
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Terminal Functions
7
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
DIO Interface Description
18
. . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Receiving/Transmitting Management Frames
27
. . . . . . . . . . .
State of DIO Signal Terminals During Hardware Reset
28
. . .
IEEE Std 802.1Q VLAN Tags on the NM Port
28
. . . . . . . . . . .
Frame Format on the NM Port
28
. . . . . . . . . . . . . . . . . . . . . . . .
Full-Duplex NM Port
31
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
NM Bandwidth and Priority
31
. . . . . . . . . . . . . . . . . . . . . . . . . . .
Interrupt Processing
31
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
PHY Management Interface
31
. . . . . . . . . . . . . . . . . . . . . . . . . . .
MAC Interface
32
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Receive Control
32
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Giant (Long) Frames
32
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Short Frames
32
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Receive Filtering of Frames
32
. . . . . . . . . . . . . . . . . . . . . . . . . .
Data Transmission
32
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Transmit Control
32
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Adaptive Performance Optimization (APO)
33
. . . . . . . . . . . . .
Interframe Gap Enforcement
33
. . . . . . . . . . . . . . . . . . . . . . . . .
Backoff
33
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Receive Versus Transmit Priority
33
. . . . . . . . . . . . . . . . . . . . .
10-/100-Mbit/s MII (ports 0–7)
34
. . . . . . . . . . . . . . . . . . . . . . . .
Speed, Duplex, and Flow-Control Negotiation
34
. . . . . . . . . .
100-/1000-Mbit/s PHY Interface (Port 8)
36
. . . . . . . . . . . . . . . . .
Speed, Duplex, and Flow-Control Negotiation
36
. . . . . . . . . .
Full-Duplex Hardware Flow Control
37
. . . . . . . . . . . . . . . . . . .
Pretagging and Extended Port Awareness
38
. . . . . . . . . . . . .
Ring-Cascade Topology
40
. . . . . . . . . . . . . . . . . . . . . . . . . . . . .
EEPROM Interface
42
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Interaction of EEPROM Load With the SIO Register
43
. . . . .
Summary of EEPROM Load Outcomes
43
. . . . . . . . . . . . . . . .
Compatibility With Future Device Revisions
44
. . . . . . . . . . . .
LED Interface
44
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Lamp Test
45
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Multi-LED Display
45
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Contents



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