LP2996 datasheet(1/18 Pages) NSC

部件名	LP2996

功能描述	DDR Termination Regulator

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制造商	NSC [National Semiconductor (TI)]

网页	http://www.national.com

标志

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2003

年 11 月

1

DS200575-04-JP

LP2996

DDR

ターミネーション・レギュレータ

概要

LP2996 は、JEDEC 標準の SSTL-2 仕様に適合する DDR-

SDRAM ターミネーションのリニア・レギュレータです。LP2996 は

負荷変動に対して優れた応答を発揮する高速オペアンプを内蔵

しています。出力段は 1.5A の連続電流を供給でき、

さらに DDR-

SDRAM ターミネーションに求められる最大 3A の変動ピークにも

対応していますが、貫通電流は発生しません。 VSENSE 端子を

介した電圧監視により優れた出力負荷レギュレーションを実現す

るとともに、チップセットや DDR DIMM に必要な VREF 電圧も生

成して出力します。

このほか LP2996 は、Suspend-to-RAM (STR) 機能をサポートす

るアクティブ LOW のシャットダウン (SD) 端子を備えています。SD

を LOW にすると、VTT 出力は TRI-STATE のハイ・インピーダン

スとなりますが、VREF はアクティブを保ちます。本モードでは待機

時消費電流が小さくなるため、電力節減を図れます。

特長

■ 電流ソースおよび電流シンク

■ 低出力電圧オフセット

■ 外付け抵抗不要

■リニア・トポロジー

■ Suspend-to-RAM (STR) 機能

■少ない外付け部品

■ サーマル・シャットダウン

■ SO-8、PSOP-8、LLP-16 パッケージで供給

アプリケーション

■ DDR-Iと DDR-II ターミネーション電圧に対応

■ SSTL-2と SSTL-3 ターミネーション

■ HSTL ターミネーション

代表的なアプリケーション回路

类似零件编号 - LP2996

制造商	部件名	数据表	功能描述
Texas Instruments	LP2996	330Kb / 21P	DDR Termination Regulator
	LP2996-N	1Mb / 26P	LP2996-N DDR Termination Regulator
	LP2996-N	1Mb / 26P	LP2996-N DDR Termination Regulator
	LP2996-N	1Mb / 28P	DDR Termination Regulator
	LP2996-N	1Mb / 28P	DDR Termination Regulator