PM0214 datasheet(7/245 Pages) STMICROELECTRONICS

7 / 245 page

DocID022708 Rev 4

7/245

PM0214

Contents

4.2.9

MPU region attribute and size register (MPU_RASR) . . . . . . . . . . . . . 189

4.2.10

MPU register map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 191

4.3

Nested vectored interrupt controller (NVIC) . . . . . . . . . . . . . . . . . . . . . . 193

4.3.1

Accessing the Cortex-M4 NVIC registers using CMSIS . . . . . . . . . . . 194

4.3.2

Interrupt set-enable registers (NVIC_ISERx) . . . . . . . . . . . . . . . . . . . . 195

4.3.3

Interrupt clear-enable registers (NVIC_ICERx) . . . . . . . . . . . . . . . . . . 196

4.3.4

Interrupt set-pending registers (NVIC_ISPRx) . . . . . . . . . . . . . . . . . . . 197

4.3.5

Interrupt clear-pending registers (NVIC_ICPRx) . . . . . . . . . . . . . . . . . 198

4.3.6

Interrupt active bit registers (NVIC_IABRx) . . . . . . . . . . . . . . . . . . . . . 199

4.3.7

Interrupt priority registers (NVIC_IPRx) . . . . . . . . . . . . . . . . . . . . . . . . 200

4.3.8

Software trigger interrupt register (NVIC_STIR) . . . . . . . . . . . . . . . . . 201

4.3.9

Level-sensitive and pulse interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . 202

4.3.10

NVIC design hints and tips . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 203

4.3.11

NVIC register map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 204

4.4

System control block (SCB) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 206

4.4.1

Auxiliary control register (ACTLR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 207

4.4.2

CPUID base register (CPUID) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 208

4.4.3

Interrupt control and state register (ICSR) . . . . . . . . . . . . . . . . . . . . . . 210

4.4.4

Vector table offset register (VTOR) . . . . . . . . . . . . . . . . . . . . . . . . . . . 212

4.4.5

Application interrupt and reset control register (AIRCR) . . . . . . . . . . . 212

4.4.6

System control register (SCR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 214

4.4.7

Configuration and control register (CCR) . . . . . . . . . . . . . . . . . . . . . . 215

4.4.8

System handler priority registers (SHPRx) . . . . . . . . . . . . . . . . . . . . . 217

4.4.9

System handler control and state register (SHCSR) . . . . . . . . . . . . . . 219

4.4.10

Configurable fault status register (CFSR; UFSR+BFSR+MMFSR) . . . 221

4.4.11

Usage fault status register (UFSR) . . . . . . . . . . . . . . . . . . . . . . . . . . . 222

4.4.12

Bus fault status register (BFSR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 223

4.4.13

Memory management fault address register (MMFSR) . . . . . . . . . . . . 224

4.4.14

Hard fault status register (HFSR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 225

4.4.15

Memory management fault address register (MMFAR) . . . . . . . . . . . . 226

4.4.16

Bus fault address register (BFAR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 226

4.4.17

Auxiliary fault status register (AFSR) . . . . . . . . . . . . . . . . . . . . . . . . . . 227

4.4.18

System control block design hints and tips . . . . . . . . . . . . . . . . . . . . . 227

4.4.19

SCB register map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 228

4.5

SysTick timer (STK) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 230

4.5.1

SysTick control and status register (STK_CTRL) . . . . . . . . . . . . . . . . 231

4.5.2

SysTick reload value register (STK_LOAD) . . . . . . . . . . . . . . . . . . . . . 232

PM0214 数据表(PDF) 7 Page - STMicroelectronics

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