VG6640 datasheet(8/126 Pages) STMICROELECTRONICS

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VG6640, VD6640

8/126

DocID023597 Rev 11

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Figure 1.

Ball assignment in Im2BGA 100 balls (top view) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16

Figure 2.

IO ring pad layout . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17

Figure 3.

Wafer description and stack . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18

Figure 4.

Block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19

Figure 5.

Custom analog block (CAB) block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21

Figure 6.

Multiple exposure HDR pixel . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22

Figure 7.

HDR video pipe. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23

Figure 8.

System state diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25

Figure 9.

Data transfer protocol . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27

Figure 10.

I2C device address . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28

Figure 11.

Data format (write) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28

Figure 12.

Data format (read) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28

Figure 13.

Data format (sequential write). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29

Figure 14.

Data format (sequential read) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29

Figure 15.

Right alignment for packing 10-bit data into two 8-bit registers . . . . . . . . . . . . . . . . . . . . . 30

Figure 16.

CSI-2 frame format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 67

Figure 17.

Hardware synchronization frame structure . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69

Figure 18.

Programmable addressable region of the pixel array . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 72

Figure 19.

Programmable frame output size . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 72

Figure 20.

2 x 2 subsampling readout example (Bayer) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74

Figure 21.

Clock settings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 75

Figure 22.

Bayer pattern . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78

Figure 23.

Coarse integration and pixel readout.. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 80

Figure 24.

Analog gain register format. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 81

Figure 25.

CCI parameter update window . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 83

Figure 26.

Control loop synchronisation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 84

Figure 27.

100% color bars . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 86

Figure 28.

Fade to gray’ color bars . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 86

Figure 29.

I2C interface timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 93

Figure 30.

Parallel (ITU) interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 96

Figure 31.

QE response data. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 98

Figure 32.

Example ethernet camera application . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 100

Figure 33.

Example stereo synchronized cameras application . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 102

Figure 34.

Power-up sequence with internal 1.2V regulator in MIPI CSI-2 mode . . . . . . . . . . . . . . . 105

Figure 35.

Power-up sequence with external 1.2V regulator in MIPI CSI-2 mode. . . . . . . . . . . . . . . 106

Figure 36.

Power-down sequence with internal 1.2V regulator in MIPI CSI-2 mode . . . . . . . . . . . . . 108

Figure 37.

Power-down sequence with external 1.2V regulator in MIPI CSI-2 mode . . . . . . . . . . . . 109

Figure 38.

Equivalent model of crystal. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110

Figure 39.

Im2BGA top view . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 114

Figure 40.

Im2BGA bottom view . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 114

Figure 41.

Im2BGA side view . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 115

Figure 42.

Im2BGA package marking information . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 116

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