ST7263BEx datasheet(10/186 Pages) STMICROELECTRONICS

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ST7263Bxx

10/186

Doc ID 7516 Rev 8

Figure 49.

Event flags and interrupt generation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 116

Figure 50.

ADC block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 126

Figure 51.

ADC conversion timings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 127

Figure 52.

Pin loading conditions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 138

Figure 53.

Pin input voltage . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 139

Figure 54.

fCPU maximum operating frequency versus VDD supply voltage . . . . . . . . . . . . . . . . . . . 141

Figure 55.

Typ. IDD in Run at fCPU = 4 and 8 MHz . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 142

Figure 56.

Typ. IDD in Wait at fCPU= 4 and 8 MHz. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 143

Figure 57.

Typical application with an external clock source . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 144

Figure 58.

Typical application with a crystal resonator . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 145

Figure 59.

Two typical applications with VPP pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 146

Figure 60.

Two typical applications with unused I/O pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 149

Figure 61.

Typ. IPU vs. VDD . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 150

Figure 62.

Typ. RPU vs. VDD . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 150

Figure 63.

VOL standard VDD=5 V . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 151

Figure 64.

VOL high sink VDD=5 V . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 152

Figure 65.

VOL very high sink VDD=5 V . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 152

Figure 66.

VOL standard vs. VDD . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 153

Figure 67.

VOL high sink vs. VDD . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 153

Figure 68.

VOL very high sink vs. VDD . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 154

Figure 69.

|VDD-VOH| @ VDD=5 V (low current) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 154

Figure 70.

|VDD-VOH| @ VDD=5 V (high current) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 155

Figure 71.

|VDD-VOH| @ IIO=2 mA (low current) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 155

Figure 72.

|VDD-VOH| @ IIO=10 mA (high current) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 156

Figure 73.

RESET pin protection when LVD is enabled . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 157

Figure 74.

RESET pin protection when LVD is disabled . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 158

Figure 75.

USB data signal rise and fall time . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 158

Figure 76.

Typical application with I2C bus and timing diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . 161

Figure 77.

Typical application with ADC . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 163

Figure 78.

ADC accuracy characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 164

Figure 79.

32-pin plastic dual in-line package, shrink 400-mil width, package outline. . . . . . . . . . . . 166

Figure 80.

34-pin plastic small outline package, 300-mil width, package outline. . . . . . . . . . . . . . . . 167

Figure 81.

24-pin plastic small outline package, 300-mil width package outline . . . . . . . . . . . . . . . . 168

Figure 82.

48-pin low profile quad flat package outline . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 169

Figure 83.

40-lead very thin fine pitch quad flat no-lead package outline . . . . . . . . . . . . . . . . . . . . . 170

Figure 84.

Option list . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 176

Figure 85.

Identifying silicon revision from device marking and box label . . . . . . . . . . . . . . . . . . . . . 183

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