PM0223 datasheet(4/110 Pages) STMICROELECTRONICS

4 / 110 page

Contents

PM0223

4/110

DocID025763 Rev 1

3.7.1

BKPT . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69

3.7.2

CPS . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 70

3.7.3

DMB . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 71

3.7.4

DSB . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 72

3.7.5

ISB . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73

3.7.6

MRS . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74

3.7.7

MSR . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 75

3.7.8

NOP . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 76

3.7.9

SEV . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77

3.7.10

SVC . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78

3.7.11

WFE . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 79

3.7.12

WFI . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 80

STM32L0 Core Peripherals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 81

4.1

About the STM32L0 core peripherals . . . . . . . . . . . . . . . . . . . . . . . . . . . . 81

4.2

Nested Vectored Interrupt Controller . . . . . . . . . . . . . . . . . . . . . . . . . . . . 82

4.2.1

Accessing the STM32L0 Cortex-M0+ NVIC registers using CMSIS . . . 82

4.2.2

Interrupt Set-enable Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 83

4.2.3

Interrupt Clear-enable Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 83

4.2.4

Interrupt Set-pending Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 84

4.2.5

Interrupt Clear-pending Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 84

4.2.6

Interrupt Priority Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 85

4.2.7

Level-sensitive and pulse interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . 86

4.2.8

NVIC usage hints and tips . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 87

4.3

System Control Block . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 88

4.3.1

The CMSIS mapping of the STM32L0 Cortex-M0+ SCB registers . . . . 88

4.3.2

CPUID Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 88

4.3.3

Interrupt Control and State Register (ICSR) . . . . . . . . . . . . . . . . . . . . . 89

4.3.4

Vector Table Offset Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 91

4.3.5

Application Interrupt and Reset Control Register . . . . . . . . . . . . . . . . . 91

4.3.6

System Control Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 92

4.3.7

Configuration and Control Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . 93

4.3.8

System Handler Priority Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 94

4.3.9

SCB usage hints and tips . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 95

4.4

SysTick timer (STK) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 95

4.4.1

SysTick Control and Status Register (STK_CSR) . . . . . . . . . . . . . . . . . 96

4.4.2

SysTick Reload Value Register (STK_RVR) . . . . . . . . . . . . . . . . . . . . . 96

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