RM0312 datasheet(8/275 Pages) STMICROELECTRONICS

8 / 275 page

Contents

RM0312

8/275

DocID022352 Rev 3

17.5.6

Output compare mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 133

17.5.7

PWM mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 134

17.5.8

Using the break function . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 138

17.5.9

Clearing the OCiREF signal on an external event . . . . . . . . . . . . . . . . 139

17.5.10 Encoder interface mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 140

17.6

TIMx interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 143

17.6.1

TIMx wait-for-event capability . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 143

17.7

TIMx registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 144

17.7.1

Control register 1 (TIMx_CR1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 144

17.7.2

Control register 2 (TIMx_CR2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 145

17.7.3

Slave mode control register (TIMx_SMCR) . . . . . . . . . . . . . . . . . . . . . 146

17.7.4

External trigger register (TIMx_ETR) . . . . . . . . . . . . . . . . . . . . . . . . . . 147

17.7.5

Interrupt enable register (TIMx_IER) . . . . . . . . . . . . . . . . . . . . . . . . . . 148

17.7.6

Status register 1 (TIMx_SR1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 148

17.7.7

Status register 2 (TIMx_SR2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 149

17.7.8

Event generation register (TIMx_EGR) . . . . . . . . . . . . . . . . . . . . . . . . 150

17.7.9

Capture/compare mode register 1 (TIMx_CCMR1) . . . . . . . . . . . . . . . 151

17.7.10 Capture/compare mode register 2 (TIMx_CCMR2) . . . . . . . . . . . . . . . 153

17.7.11 Capture/compare enable register 1 (TIMx_CCER1) . . . . . . . . . . . . . . 154

17.7.12 Counter high (TIMx_CNTRH) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 155

17.7.13 Counter low (TIMx_CNTRL) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 155

17.7.14 Prescaler register (TIMx_PSCR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 155

17.7.15 Auto-reload register high (TIMx_ARRH) . . . . . . . . . . . . . . . . . . . . . . . 156

17.7.16 Auto-reload register low (TIMx_ARRL) . . . . . . . . . . . . . . . . . . . . . . . . 156

17.7.17 Capture/compare register 1 high (TIMx_CCR1H) . . . . . . . . . . . . . . . . 157

17.7.18 Capture/compare register 1 low (TIMx_CCR1L) . . . . . . . . . . . . . . . . . 157

17.7.19 Capture/compare register 2 high (TIMx_CCR2H) . . . . . . . . . . . . . . . . 158

17.7.20 Capture/compare register 2 low (TIMx_CCR2L) . . . . . . . . . . . . . . . . . 158

17.7.21 Break register (TIMx_BKR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 159

17.7.22 Output idle state register (TIMx_OISR) . . . . . . . . . . . . . . . . . . . . . . . . 161

17.7.23 TIMx register map and reset values . . . . . . . . . . . . . . . . . . . . . . . . . . 161

8-bit basic timer (TIM4) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 163

18.1

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 163

18.2

TIM4 main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 163

18.3

TIM4 interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 163

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