STM8S datasheet(5/467 Pages) STMICROELECTRONICS

5 / 467 page

DocID14587 Rev 14

5/467

RM0016

Contents

9.7

Clock-out capability (CCO) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 89

9.8

CLK interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 89

9.9

CLK register description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 90

9.9.1

Internal clock register (CLK_ICKR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 90

9.9.2

External clock register (CLK_ECKR) . . . . . . . . . . . . . . . . . . . . . . . . . . . 91

9.9.3

Clock master status register (CLK_CMSR) . . . . . . . . . . . . . . . . . . . . . . 92

9.9.4

Clock master switch register (CLK_SWR) . . . . . . . . . . . . . . . . . . . . . . . 92

9.9.5

Switch control register (CLK_SWCR) . . . . . . . . . . . . . . . . . . . . . . . . . . 93

9.9.6

Clock divider register (CLK_CKDIVR) . . . . . . . . . . . . . . . . . . . . . . . . . . 94

9.9.7

Peripheral clock gating register 1 (CLK_PCKENR1) . . . . . . . . . . . . . . . 95

9.9.8

Peripheral clock gating register 2 (CLK_PCKENR2) . . . . . . . . . . . . . . . 96

9.9.9

Clock security system register (CLK_CSSR) . . . . . . . . . . . . . . . . . . . . . 97

9.9.10

Configurable clock output register (CLK_CCOR) . . . . . . . . . . . . . . . . . 98

9.9.11

HSI clock calibration trimming register (CLK_HSITRIMR) . . . . . . . . . . . 99

9.9.12

SWIM clock control register (CLK_SWIMCCR) . . . . . . . . . . . . . . . . . . . 99

9.10

CLK register map and reset values . . . . . . . . . . . . . . . . . . . . . . . . . . . . 100

Power management . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 101

10.1

General considerations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 101

10.1.1

Clock management for low consumption . . . . . . . . . . . . . . . . . . . . . . . 102

10.2

Low power modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 102

10.2.1

Wait mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103

10.2.2

Halt mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103

10.2.3

Active-halt modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103

10.3

Additional analog power controls . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 104

10.3.1

Fast Flash wakeup from Halt mode . . . . . . . . . . . . . . . . . . . . . . . . . . . 104

10.3.2

Very low Flash consumption in Active-halt mode . . . . . . . . . . . . . . . . . 104

General purpose I/O ports (GPIO) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 105

11.1

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 105

11.2

GPIO main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 105

11.3

Port configuration and usage . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 106

11.3.1

Input modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 107

11.3.2

Output modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108

11.4

Reset configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108

11.5

Unused I/O pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108

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